01 · Le poste
Descriptif du stage
Votre rôle
Contexte de la mission:
Viveris développe sa solution RISC-V dédiée au traitement d'image et à la cryptographie.
L'objectif de ce stage est de concevoir un système complet sur FPGA, intégrant un coeur processeur RISC-V open source, et de l'optimiser via une co-conception matériel/logiciel.
L'objectif de ce stage est de concevoir un système complet sur FPGA, intégrant un coeur processeur RISC-V open source, et de l'optimiser via une co-conception matériel/logiciel.
Profil recherché
Profil recherché :- Étudiant en dernière année d'école d'ingénieur ou diplôme universitaire équivalent ;
- Vous avez de bonnes connaissances en FPGA et architecture des processeurs.
Environnement Technique:
- OS : FreeRTOS, Linux
- Langages : VHDL, C/C++
- Environnement IA : Mistral, Copilot, Cursor
- Modélisation : UML
- ALM : Tuleap
- CI/CD : Jenkins, Git, Harbor/Docker, Klocwork
02 · Monter en compétences
Formations utiles
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